drivers/gpu/drm/nouveau/nouveau_dma.h

   1 /*
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   4  *
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  23  * WITH THE SOFTWARE OR THE USE OR OTHER DEALINGS IN THE SOFTWARE.
  24  *
  25  */
  26
  27 #ifndef __NOUVEAU_DMA_H__
  28 #define __NOUVEAU_DMA_H__
  29
  30 #include "nouveau_bo.h"
  31 #include "nouveau_chan.h"
  32
  33 int nouveau_dma_wait(struct nouveau_channel *, int slots, int size);
  34 void nv50_dma_push(struct nouveau_channel *, u64 addr, u32 length,
  35                    bool no_prefetch);
  36
  37 /*
  38  * There's a hw race condition where you can't jump to your PUT offset,
  39  * to avoid this we jump to offset + SKIPS and fill the difference with
  40  * NOPs.
  41  *
  42  * xf86-video-nv configures the DMA fetch size to 32 bytes, and uses
  43  * a SKIPS value of 8.  Lets assume that the race condition is to do
  44  * with writing into the fetch area, we configure a fetch size of 128
  45  * bytes so we need a larger SKIPS value.
  46  */
  47 #define NOUVEAU_DMA_SKIPS (128 / 4)
  48
  49 /* Maximum push buffer size. */
  50 #define NV50_DMA_PUSH_MAX_LENGTH 0x7fffff
  51
  52 /* Maximum IBs per ring. */
  53 #define NV50_DMA_IB_MAX ((0x02000 / 8) - 1)
  54
  55 /* Object handles - for stuff that's doesn't use handle == oclass. */
  56 enum {
  57         NvDmaFB         = 0x80000002,
  58         NvDmaTT         = 0x80000003,
  59         NvNotify0       = 0x80000006,
  60         NvSema          = 0x8000000f,
  61         NvEvoSema0      = 0x80000010,
  62         NvEvoSema1      = 0x80000011,
  63 };
  64
  65 static __must_check inline int
  66 RING_SPACE(struct nouveau_channel *chan, int size)
  67 {
  68         int ret;
  69
  70         ret = nouveau_dma_wait(chan, 1, size);
  71         if (ret)
  72                 return ret;
  73
  74         chan->dma.free -= size;
  75         return 0;
  76 }
  77
  78 static inline void
  79 OUT_RING(struct nouveau_channel *chan, int data)
  80 {
  81         nouveau_bo_wr32(chan->push.buffer, chan->dma.cur++, data);
  82 }
  83
  84 #define WRITE_PUT(val) do {                                                    \
  85         mb();                                                   \
  86         nouveau_bo_rd32(chan->push.buffer, 0);                                 \
  87         nvif_wr32(&chan->user, chan->user_put, ((val) << 2) + chan->push.addr);\
  88 } while (0)
  89
  90 static inline void
  91 FIRE_RING(struct nouveau_channel *chan)
  92 {
  93         if (chan->dma.cur == chan->dma.put)
  94                 return;
  95         chan->accel_done = true;
  96
  97         if (chan->dma.ib_max) {
  98                 nv50_dma_push(chan, chan->push.addr + (chan->dma.put << 2),
  99                               (chan->dma.cur - chan->dma.put) << 2, false);
 100         } else {
 101                 WRITE_PUT(chan->dma.cur);
 102         }
 103
 104         chan->dma.put = chan->dma.cur;
 105 }
 106
 107 static inline void
 108 WIND_RING(struct nouveau_channel *chan)
 109 {
 110         chan->dma.cur = chan->dma.put;
 111 }
 112
 113 /* NV_SW object class */
 114 #define NV_SW_DMA_VBLSEM                                             0x0000018c
 115 #define NV_SW_VBLSEM_OFFSET                                          0x00000400
 116 #define NV_SW_VBLSEM_RELEASE_VALUE                                   0x00000404
 117 #define NV_SW_VBLSEM_RELEASE                                         0x00000408
 118 #define NV_SW_PAGE_FLIP                                              0x00000500
 119
 120 #endif