* <mux_reg conf_reg input_reg mux_mode input_val>
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#define MX25_PAD_RTCK__OWIRE 0x1ec 0x3e4 0x000 0x01 0x000
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#define MX25_PAD_DE_B__DE_B 0x1f0 0x3ec 0x000 0x00 0x000
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