include/asm-blackfin/portmux.h

   1 /*
   2  * Common header file for blackfin family of processors.
   3  *
   4  */
   5
   6 #ifndef _PORTMUX_H_
   7 #define _PORTMUX_H_
   8
   9 #define P_IDENT(x)      ((x) & 0x1FF)
  10 #define P_FUNCT(x)      (((x) & 0x3) << 9)
  11 #define P_FUNCT2MUX(x)  (((x) >> 9) & 0x3)
  12 #define P_DEFINED       0x8000
  13 #define P_UNDEF         0x4000
  14 #define P_MAYSHARE      0x2000
  15 #define P_DONTCARE      0x1000
  16
  17
  18 int peripheral_request(unsigned short per, const char *label);
  19 void peripheral_free(unsigned short per);
  20 int peripheral_request_list(const unsigned short per[], const char *label);
  21 void peripheral_free_list(const unsigned short per[]);
  22
  23 #include <asm/gpio.h>
  24 #include <asm/mach/portmux.h>
  25
  26 #ifndef P_SPORT2_TFS
  27 #define P_SPORT2_TFS P_UNDEF
  28 #endif
  29
  30 #ifndef P_SPORT2_DTSEC
  31 #define P_SPORT2_DTSEC P_UNDEF
  32 #endif
  33
  34 #ifndef P_SPORT2_DTPRI
  35 #define P_SPORT2_DTPRI P_UNDEF
  36 #endif
  37
  38 #ifndef P_SPORT2_TSCLK
  39 #define P_SPORT2_TSCLK P_UNDEF
  40 #endif
  41
  42 #ifndef P_SPORT2_RFS
  43 #define P_SPORT2_RFS P_UNDEF
  44 #endif
  45
  46 #ifndef P_SPORT2_DRSEC
  47 #define P_SPORT2_DRSEC P_UNDEF
  48 #endif
  49
  50 #ifndef P_SPORT2_DRPRI
  51 #define P_SPORT2_DRPRI P_UNDEF
  52 #endif
  53
  54 #ifndef P_SPORT2_RSCLK
  55 #define P_SPORT2_RSCLK P_UNDEF
  56 #endif
  57
  58 #ifndef P_SPORT3_TFS
  59 #define P_SPORT3_TFS P_UNDEF
  60 #endif
  61
  62 #ifndef P_SPORT3_DTSEC
  63 #define P_SPORT3_DTSEC P_UNDEF
  64 #endif
  65
  66 #ifndef P_SPORT3_DTPRI
  67 #define P_SPORT3_DTPRI P_UNDEF
  68 #endif
  69
  70 #ifndef P_SPORT3_TSCLK
  71 #define P_SPORT3_TSCLK P_UNDEF
  72 #endif
  73
  74 #ifndef P_SPORT3_RFS
  75 #define P_SPORT3_RFS P_UNDEF
  76 #endif
  77
  78 #ifndef P_SPORT3_DRSEC
  79 #define P_SPORT3_DRSEC P_UNDEF
  80 #endif
  81
  82 #ifndef P_SPORT3_DRPRI
  83 #define P_SPORT3_DRPRI P_UNDEF
  84 #endif
  85
  86 #ifndef P_SPORT3_RSCLK
  87 #define P_SPORT3_RSCLK P_UNDEF
  88 #endif
  89
  90 #ifndef P_TMR4
  91 #define P_TMR4 P_UNDEF
  92 #endif
  93
  94 #ifndef P_TMR5
  95 #define P_TMR5 P_UNDEF
  96 #endif
  97
  98 #ifndef P_TMR6
  99 #define P_TMR6 P_UNDEF
 100 #endif
 101
 102 #ifndef P_TMR7
 103 #define P_TMR7 P_UNDEF
 104 #endif
 105
 106 #ifndef P_TWI1_SCL
 107 #define P_TWI1_SCL P_UNDEF
 108 #endif
 109
 110 #ifndef P_TWI1_SDA
 111 #define P_TWI1_SDA P_UNDEF
 112 #endif
 113
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 115 #define P_UART3_RTS P_UNDEF
 116 #endif
 117
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 119 #define P_UART3_CTS P_UNDEF
 120 #endif
 121
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 123 #define P_UART2_TX P_UNDEF
 124 #endif
 125
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 127 #define P_UART2_RX P_UNDEF
 128 #endif
 129
 130 #ifndef P_UART3_TX
 131 #define P_UART3_TX P_UNDEF
 132 #endif
 133
 134 #ifndef P_UART3_RX
 135 #define P_UART3_RX P_UNDEF
 136 #endif
 137
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 139 #define P_SPI2_SS P_UNDEF
 140 #endif
 141
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 144 #endif
 145
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 148 #endif
 149
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 151 #define P_SPI2_SSEL3 P_UNDEF
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 153
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 155 #define P_SPI2_SSEL4 P_UNDEF
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 157
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 159 #define P_SPI2_SSEL5 P_UNDEF
 160 #endif
 161
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 163 #define P_SPI2_SSEL6 P_UNDEF
 164 #endif
 165
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 167 #define P_SPI2_SSEL7 P_UNDEF
 168 #endif
 169
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 171 #define P_SPI2_SCK P_UNDEF
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 175 #define P_SPI2_MOSI P_UNDEF
 176 #endif
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 179 #define P_SPI2_MISO P_UNDEF
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 185
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 187 #define P_TMR1 P_UNDEF
 188 #endif
 189
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 191 #define P_TMR2 P_UNDEF
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 193
 194 #ifndef P_TMR3
 195 #define P_TMR3 P_UNDEF
 196 #endif
 197
 198 #ifndef P_SPORT0_TFS
 199 #define P_SPORT0_TFS P_UNDEF
 200 #endif
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 203 #define P_SPORT0_DTSEC P_UNDEF
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 207 #define P_SPORT0_DTPRI P_UNDEF
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 211 #define P_SPORT0_TSCLK P_UNDEF
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 215 #define P_SPORT0_RFS P_UNDEF
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 219 #define P_SPORT0_DRSEC P_UNDEF
 220 #endif
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 222 #ifndef P_SPORT0_DRPRI
 223 #define P_SPORT0_DRPRI P_UNDEF
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 227 #define P_SPORT0_RSCLK P_UNDEF
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 229
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 231 #define P_SD_D0 P_UNDEF
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 235 #define P_SD_D1 P_UNDEF
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 237
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 239 #define P_SD_D2 P_UNDEF
 240 #endif
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 243 #define P_SD_D3 P_UNDEF
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 248 #endif
 249
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 251 #define P_SD_CMD P_UNDEF
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 269
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 279 #define P_PPI1_D4 P_UNDEF
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 283 #define P_PPI1_D5 P_UNDEF
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 287 #define P_PPI1_D6 P_UNDEF
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 289
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 293
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 297
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 309
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 311 #define P_PPI1_D12 P_UNDEF
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 313
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 347 #define P_HOST_D13 P_UNDEF
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 351 #define P_HOST_D14 P_UNDEF
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 355 #define P_HOST_D15 P_UNDEF
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 379 #define P_HOST_D5 P_UNDEF
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 381
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 391 #define P_SPORT1_TFS P_UNDEF
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 395 #define P_SPORT1_DTSEC P_UNDEF
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 399 #define P_SPORT1_DTPRI P_UNDEF
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 407 #define P_SPORT1_RFS P_UNDEF
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 411 #define P_SPORT1_DRSEC P_UNDEF
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 415 #define P_SPORT1_DRPRI P_UNDEF
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 425
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 431 #define P_PPI2_D2 P_UNDEF
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 439 #define P_PPI2_D4 P_UNDEF
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 451 #define P_PPI2_D7 P_UNDEF
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 489
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 493
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 509
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 511 #define P_SPI0_SCK P_UNDEF
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 513
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 515 #define P_SPI0_MISO P_UNDEF
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 519 #define P_SPI0_MOSI P_UNDEF
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 521
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 523 #define P_SPI0_SS P_UNDEF
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 525
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 527 #define P_SPI0_SSEL1 P_UNDEF
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 529
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 531 #define P_SPI0_SSEL2 P_UNDEF
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 535 #define P_SPI0_SSEL3 P_UNDEF
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 537
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 539 #define P_SPI0_SSEL4 P_UNDEF
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 541
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 543 #define P_SPI0_SSEL5 P_UNDEF
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 545
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 547 #define P_SPI0_SSEL6 P_UNDEF
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 549
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 551 #define P_SPI0_SSEL7 P_UNDEF
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 553
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 579 #define P_PPI1_FS2 P_UNDEF
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 583 #define P_TWI0_SCL P_UNDEF
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 621
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 631 #define P_PPI0_D2 P_UNDEF
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 633
 634 #ifndef P_PPI0_D3
 635 #define P_PPI0_D3 P_UNDEF
 636 #endif
 637
 638 #ifndef P_PPI0_D4
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 640 #endif
 641
 642 #ifndef P_PPI0_D5
 643 #define P_PPI0_D5 P_UNDEF
 644 #endif
 645
 646 #ifndef P_PPI0_D6
 647 #define P_PPI0_D6 P_UNDEF
 648 #endif
 649
 650 #ifndef P_PPI0_D7
 651 #define P_PPI0_D7 P_UNDEF
 652 #endif
 653
 654 #ifndef P_PPI0_D8
 655 #define P_PPI0_D8 P_UNDEF
 656 #endif
 657
 658 #ifndef P_PPI0_D9
 659 #define P_PPI0_D9 P_UNDEF
 660 #endif
 661
 662 #ifndef P_PPI0_D10
 663 #define P_PPI0_D10 P_UNDEF
 664 #endif
 665
 666 #ifndef P_PPI0_D11
 667 #define P_PPI0_D11 P_UNDEF
 668 #endif
 669
 670 #ifndef P_PPI0_D12
 671 #define P_PPI0_D12 P_UNDEF
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 673
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 677
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 681
 682 #ifndef P_PPI0_D15
 683 #define P_PPI0_D15 P_UNDEF
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 685
 686 #ifndef P_ATAPI_D0A
 687 #define P_ATAPI_D0A P_UNDEF
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 689
 690 #ifndef P_ATAPI_D1A
 691 #define P_ATAPI_D1A P_UNDEF
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 693
 694 #ifndef P_ATAPI_D2A
 695 #define P_ATAPI_D2A P_UNDEF
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 697
 698 #ifndef P_ATAPI_D3A
 699 #define P_ATAPI_D3A P_UNDEF
 700 #endif
 701
 702 #ifndef P_ATAPI_D4A
 703 #define P_ATAPI_D4A P_UNDEF
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 705
 706 #ifndef P_ATAPI_D5A
 707 #define P_ATAPI_D5A P_UNDEF
 708 #endif
 709
 710 #ifndef P_ATAPI_D6A
 711 #define P_ATAPI_D6A P_UNDEF
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 713
 714 #ifndef P_ATAPI_D7A
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 717
 718 #ifndef P_ATAPI_D8A
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 721
 722 #ifndef P_ATAPI_D9A
 723 #define P_ATAPI_D9A P_UNDEF
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 725
 726 #ifndef P_ATAPI_D10A
 727 #define P_ATAPI_D10A P_UNDEF
 728 #endif
 729
 730 #ifndef P_ATAPI_D11A
 731 #define P_ATAPI_D11A P_UNDEF
 732 #endif
 733
 734 #ifndef P_ATAPI_D12A
 735 #define P_ATAPI_D12A P_UNDEF
 736 #endif
 737
 738 #ifndef P_ATAPI_D13A
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 740 #endif
 741
 742 #ifndef P_ATAPI_D14A
 743 #define P_ATAPI_D14A P_UNDEF
 744 #endif
 745
 746 #ifndef P_ATAPI_D15A
 747 #define P_ATAPI_D15A P_UNDEF
 748 #endif
 749
 750 #ifndef P_PPI0_CLK
 751 #define P_PPI0_CLK P_UNDEF
 752 #endif
 753
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 756 #endif
 757
 758 #ifndef P_PPI0_FS2
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 760 #endif
 761
 762 #ifndef P_PPI0_D16
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 765
 766 #ifndef P_PPI0_D17
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 769
 770 #ifndef P_SPI1_SSEL1
 771 #define P_SPI1_SSEL1 P_UNDEF
 772 #endif
 773
 774 #ifndef P_SPI1_SSEL2
 775 #define P_SPI1_SSEL2 P_UNDEF
 776 #endif
 777
 778 #ifndef P_SPI1_SSEL3
 779 #define P_SPI1_SSEL3 P_UNDEF
 780 #endif
 781
 782
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 784 #define P_SPI1_SSEL4 P_UNDEF
 785 #endif
 786
 787 #ifndef P_SPI1_SSEL5
 788 #define P_SPI1_SSEL5 P_UNDEF
 789 #endif
 790
 791 #ifndef P_SPI1_SSEL6
 792 #define P_SPI1_SSEL6 P_UNDEF
 793 #endif
 794
 795 #ifndef P_SPI1_SSEL7
 796 #define P_SPI1_SSEL7 P_UNDEF
 797 #endif
 798
 799 #ifndef P_SPI1_SCK
 800 #define P_SPI1_SCK P_UNDEF
 801 #endif
 802
 803 #ifndef P_SPI1_MISO
 804 #define P_SPI1_MISO P_UNDEF
 805 #endif
 806
 807 #ifndef P_SPI1_MOSI
 808 #define P_SPI1_MOSI P_UNDEF
 809 #endif
 810
 811 #ifndef P_SPI1_SS
 812 #define P_SPI1_SS P_UNDEF
 813 #endif
 814
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 818
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 820 #define P_CAN0_RX P_UNDEF
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 822
 823 #ifndef P_CAN1_TX
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 826
 827 #ifndef P_CAN1_RX
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 830
 831 #ifndef P_ATAPI_A0A
 832 #define P_ATAPI_A0A P_UNDEF
 833 #endif
 834
 835 #ifndef P_ATAPI_A1A
 836 #define P_ATAPI_A1A P_UNDEF
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 838
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 840 #define P_ATAPI_A2A P_UNDEF
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 842
 843 #ifndef P_HOST_CE
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 846
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 850
 851 #ifndef P_HOST_WR
 852 #define P_HOST_WR P_UNDEF
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 854
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 856 #define P_MTXONB P_UNDEF
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 858
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 860 #define P_PPI2_FS2 P_UNDEF
 861 #endif
 862
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 864 #define P_PPI2_FS1 P_UNDEF
 865 #endif
 866
 867 #ifndef P_PPI2_CLK
 868 #define P_PPI2_CLK P_UNDEF
 869 #endif
 870
 871 #ifndef P_CNT_CZM
 872 #define P_CNT_CZM P_UNDEF
 873 #endif
 874
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 876 #define P_UART1_TX P_UNDEF
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 878
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 880 #define P_UART1_RX P_UNDEF
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 882
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 884 #define P_ATAPI_RESET P_UNDEF
 885 #endif
 886
 887 #ifndef P_HOST_ADDR
 888 #define P_HOST_ADDR P_UNDEF
 889 #endif
 890
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 894
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 896 #define P_MTX P_UNDEF
 897 #endif
 898
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 900 #define P_MRX P_UNDEF
 901 #endif
 902
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 904 #define P_MRXONB P_UNDEF
 905 #endif
 906
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 909 #endif
 910
 911 #ifndef P_A5
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 913 #endif
 914
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 917 #endif
 918
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 920 #define P_A7 P_UNDEF
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 922
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 925 #endif
 926
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 930
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 932 #define P_PPI1_FS3 P_UNDEF
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 934
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 936 #define P_PPI2_FS3 P_UNDEF
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 938
 939 #ifndef P_TMR8
 940 #define P_TMR8 P_UNDEF
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 942
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 945 #endif
 946
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 948 #define P_TMR10 P_UNDEF
 949 #endif
 950 #ifndef P_TMR11
 951 #define P_TMR11 P_UNDEF
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 953
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 955 #define P_DMAR0 P_UNDEF
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 957
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 959 #define P_DMAR1 P_UNDEF
 960 #endif
 961
 962 #ifndef P_PPI0_FS3
 963 #define P_PPI0_FS3 P_UNDEF
 964 #endif
 965
 966 #ifndef P_CNT_CDG
 967 #define P_CNT_CDG P_UNDEF
 968 #endif
 969
 970 #ifndef P_CNT_CUD
 971 #define P_CNT_CUD P_UNDEF
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 973
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 975 #define P_A10 P_UNDEF
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 977
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 981
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 983 #define P_A12 P_UNDEF
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 985
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 989
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 991 #define P_A14 P_UNDEF
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 993
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 995 #define P_A15 P_UNDEF
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 997
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 999 #define P_A16 P_UNDEF
1000 #endif
1001
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1003 #define P_A17 P_UNDEF
1004 #endif
1005
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1008 #endif
1009
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1011 #define P_A19 P_UNDEF
1012 #endif
1013
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1015 #define P_A20 P_UNDEF
1016 #endif
1017
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1019 #define P_A21 P_UNDEF
1020 #endif
1021
1022 #ifndef P_A22
1023 #define P_A22 P_UNDEF
1024 #endif
1025
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1027 #define P_A23 P_UNDEF
1028 #endif
1029
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1031 #define P_A24 P_UNDEF
1032 #endif
1033
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1037
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1039 #define P_NOR_CLK P_UNDEF
1040 #endif
1041
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1043 #define  P_TMRCLK P_UNDEF
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1045
1046 #ifndef P_AMC_ARDY_NOR_WAIT
1047 #define P_AMC_ARDY_NOR_WAIT P_UNDEF
1048 #endif
1049
1050 #ifndef P_NAND_CE
1051 #define P_NAND_CE P_UNDEF
1052 #endif
1053
1054 #ifndef P_NAND_RB
1055 #define P_NAND_RB P_UNDEF
1056 #endif
1057
1058 #ifndef P_ATAPI_DIOR
1059 #define P_ATAPI_DIOR P_UNDEF
1060 #endif
1061
1062 #ifndef P_ATAPI_DIOW
1063 #define P_ATAPI_DIOW P_UNDEF
1064 #endif
1065
1066 #ifndef P_ATAPI_CS0
1067 #define P_ATAPI_CS0 P_UNDEF
1068 #endif
1069
1070 #ifndef P_ATAPI_CS1
1071 #define P_ATAPI_CS1 P_UNDEF
1072 #endif
1073
1074 #ifndef P_ATAPI_DMACK
1075 #define P_ATAPI_DMACK P_UNDEF
1076 #endif
1077
1078 #ifndef P_ATAPI_DMARQ
1079 #define P_ATAPI_DMARQ P_UNDEF
1080 #endif
1081
1082 #ifndef P_ATAPI_INTRQ
1083 #define P_ATAPI_INTRQ P_UNDEF
1084 #endif
1085
1086 #ifndef P_ATAPI_IORDY
1087 #define P_ATAPI_IORDY P_UNDEF
1088 #endif
1089
1090 #ifndef P_AMC_BR
1091 #define P_AMC_BR P_UNDEF
1092 #endif
1093
1094 #ifndef P_AMC_BG
1095 #define P_AMC_BG P_UNDEF
1096 #endif
1097
1098 #ifndef P_AMC_BGH
1099 #define P_AMC_BGH P_UNDEF
1100 #endif
1101
1102 /* EMAC */
1103
1104 #ifndef P_MII0_ETxD0
1105 #define P_MII0_ETxD0 P_UNDEF
1106 #endif
1107
1108 #ifndef P_MII0_ETxD1
1109 #define P_MII0_ETxD1 P_UNDEF
1110 #endif
1111
1112 #ifndef P_MII0_ETxD2
1113 #define P_MII0_ETxD2 P_UNDEF
1114 #endif
1115
1116 #ifndef P_MII0_ETxD3
1117 #define P_MII0_ETxD3 P_UNDEF
1118 #endif
1119
1120 #ifndef P_MII0_ETxEN
1121 #define P_MII0_ETxEN P_UNDEF
1122 #endif
1123
1124 #ifndef P_MII0_TxCLK
1125 #define P_MII0_TxCLK P_UNDEF
1126 #endif
1127
1128 #ifndef P_MII0_PHYINT
1129 #define P_MII0_PHYINT P_UNDEF
1130 #endif
1131
1132 #ifndef P_MII0_COL
1133 #define P_MII0_COL P_UNDEF
1134 #endif
1135
1136 #ifndef P_MII0_ERxD0
1137 #define P_MII0_ERxD0 P_UNDEF
1138 #endif
1139
1140 #ifndef P_MII0_ERxD1
1141 #define P_MII0_ERxD1 P_UNDEF
1142 #endif
1143
1144 #ifndef P_MII0_ERxD2
1145 #define P_MII0_ERxD2 P_UNDEF
1146 #endif
1147
1148 #ifndef P_MII0_ERxD3
1149 #define P_MII0_ERxD3 P_UNDEF
1150 #endif
1151
1152 #ifndef P_MII0_ERxDV
1153 #define P_MII0_ERxDV P_UNDEF
1154 #endif
1155
1156 #ifndef P_MII0_ERxCLK
1157 #define P_MII0_ERxCLK P_UNDEF
1158 #endif
1159
1160 #ifndef P_MII0_ERxER
1161 #define P_MII0_ERxER P_UNDEF
1162 #endif
1163
1164 #ifndef P_MII0_CRS
1165 #define P_MII0_CRS P_UNDEF
1166 #endif
1167
1168 #ifndef P_RMII0_REF_CLK
1169 #define P_RMII0_REF_CLK P_UNDEF
1170 #endif
1171
1172 #ifndef P_RMII0_MDINT
1173 #define P_RMII0_MDINT P_UNDEF
1174 #endif
1175
1176 #ifndef P_RMII0_CRS_DV
1177 #define P_RMII0_CRS_DV P_UNDEF
1178 #endif
1179
1180 #ifndef P_MDC
1181 #define P_MDC P_UNDEF
1182 #endif
1183
1184 #ifndef P_MDIO
1185 #define P_MDIO P_UNDEF
1186 #endif
1187
1188 #endif                          /* _PORTMUX_H_ */