drivers/gpu/drm/amd/amdgpu/amdgpu_irq.h

   1 /*
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  20  * OTHER DEALINGS IN THE SOFTWARE.
  21  *
  22  */
  23
  24 #ifndef __AMDGPU_IRQ_H__
  25 #define __AMDGPU_IRQ_H__
  26
  27 #include <linux/irqdomain.h>
  28 #include "amdgpu_ih.h"
  29
  30 #define AMDGPU_MAX_IRQ_SRC_ID   0x100
  31 #define AMDGPU_MAX_IRQ_CLIENT_ID        0x100
  32
  33 struct amdgpu_device;
  34 struct amdgpu_iv_entry;
  35
  36 enum amdgpu_interrupt_state {
  37         AMDGPU_IRQ_STATE_DISABLE,
  38         AMDGPU_IRQ_STATE_ENABLE,
  39 };
  40
  41 struct amdgpu_irq_src {
  42         unsigned                                num_types;
  43         atomic_t                                *enabled_types;
  44         const struct amdgpu_irq_src_funcs       *funcs;
  45         void *data;
  46 };
  47
  48 struct amdgpu_irq_client {
  49         struct amdgpu_irq_src **sources;
  50 };
  51
  52 /* provided by interrupt generating IP blocks */
  53 struct amdgpu_irq_src_funcs {
  54         int (*set)(struct amdgpu_device *adev, struct amdgpu_irq_src *source,
  55                    unsigned type, enum amdgpu_interrupt_state state);
  56
  57         int (*process)(struct amdgpu_device *adev,
  58                        struct amdgpu_irq_src *source,
  59                        struct amdgpu_iv_entry *entry);
  60 };
  61
  62 struct amdgpu_irq {
  63         bool                            installed;
  64         spinlock_t                      lock;
  65         /* interrupt sources */
  66         struct amdgpu_irq_client        client[AMDGPU_IH_CLIENTID_MAX];
  67
  68         /* status, etc. */
  69         bool                            msi_enabled; /* msi enabled */
  70
  71         /* interrupt ring */
  72         struct amdgpu_ih_ring           ih;
  73         const struct amdgpu_ih_funcs    *ih_funcs;
  74
  75         /* gen irq stuff */
  76         struct irq_domain               *domain; /* GPU irq controller domain */
  77         unsigned                        virq[AMDGPU_MAX_IRQ_SRC_ID];
  78         uint32_t                        srbm_soft_reset;
  79 };
  80
  81 void amdgpu_irq_disable_all(struct amdgpu_device *adev);
  82 irqreturn_t amdgpu_irq_handler(int irq, void *arg);
  83
  84 int amdgpu_irq_init(struct amdgpu_device *adev);
  85 void amdgpu_irq_fini(struct amdgpu_device *adev);
  86 int amdgpu_irq_add_id(struct amdgpu_device *adev,
  87                       unsigned client_id, unsigned src_id,
  88                       struct amdgpu_irq_src *source);
  89 void amdgpu_irq_dispatch(struct amdgpu_device *adev,
  90                          struct amdgpu_iv_entry *entry);
  91 int amdgpu_irq_update(struct amdgpu_device *adev, struct amdgpu_irq_src *src,
  92                       unsigned type);
  93 int amdgpu_irq_get(struct amdgpu_device *adev, struct amdgpu_irq_src *src,
  94                    unsigned type);
  95 int amdgpu_irq_put(struct amdgpu_device *adev, struct amdgpu_irq_src *src,
  96                    unsigned type);
  97 bool amdgpu_irq_enabled(struct amdgpu_device *adev, struct amdgpu_irq_src *src,
  98                         unsigned type);
  99 void amdgpu_irq_gpu_reset_resume_helper(struct amdgpu_device *adev);
 100
 101 int amdgpu_irq_add_domain(struct amdgpu_device *adev);
 102 void amdgpu_irq_remove_domain(struct amdgpu_device *adev);
 103 unsigned amdgpu_irq_create_mapping(struct amdgpu_device *adev, unsigned src_id);
 104
 105 #endif