Documentation/devicetree/bindings/mtd/fsl-quadspi.txt

   1 * Freescale Quad Serial Peripheral Interface(QuadSPI)
   2
   3 Required properties:
   4   - compatible : Should be "fsl,vf610-qspi", "fsl,imx6sx-qspi",
   5                  "fsl,imx7d-qspi", "fsl,imx6ul-qspi",
   6                  "fsl,ls1021a-qspi"
   7                  or
   8                  "fsl,ls2080a-qspi" followed by "fsl,ls1021a-qspi",
   9                  "fsl,ls1043a-qspi" followed by "fsl,ls1021a-qspi"
  10   - reg : the first contains the register location and length,
  11           the second contains the memory mapping address and length
  12   - reg-names: Should contain the reg names "QuadSPI" and "QuadSPI-memory"
  13   - interrupts : Should contain the interrupt for the device
  14   - clocks : The clocks needed by the QuadSPI controller
  15   - clock-names : Should contain the name of the clocks: "qspi_en" and "qspi".
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  17 Optional properties:
  18   - fsl,qspi-has-second-chip: The controller has two buses, bus A and bus B.
  19                               Each bus can be connected with two NOR flashes.
  20                               Most of the time, each bus only has one NOR flash
  21                               connected, this is the default case.
  22                               But if there are two NOR flashes connected to the
  23                               bus, you should enable this property.
  24                               (Please check the board's schematic.)
  25   - big-endian : That means the IP register is big endian
  26
  27 Example:
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  29 qspi0: quadspi@40044000 {
  30         compatible = "fsl,vf610-qspi";
  31         reg = <0x40044000 0x1000>, <0x20000000 0x10000000>;
  32         reg-names = "QuadSPI", "QuadSPI-memory";
  33         interrupts = <0 24 IRQ_TYPE_LEVEL_HIGH>;
  34         clocks = <&clks VF610_CLK_QSPI0_EN>,
  35                 <&clks VF610_CLK_QSPI0>;
  36         clock-names = "qspi_en", "qspi";
  37
  38         flash0: s25fl128s@0 {
  39                 ....
  40         };
  41 };
  42
  43 Example showing the usage of two SPI NOR devices:
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  45 &qspi2 {
  46         pinctrl-names = "default";
  47         pinctrl-0 = <&pinctrl_qspi2>;
  48         status = "okay";
  49
  50         flash0: n25q256a@0 {
  51                 #address-cells = <1>;
  52                 #size-cells = <1>;
  53                 compatible = "micron,n25q256a", "jedec,spi-nor";
  54                 spi-max-frequency = <29000000>;
  55                 reg = <0>;
  56         };
  57
  58         flash1: n25q256a@1 {
  59                 #address-cells = <1>;
  60                 #size-cells = <1>;
  61                 compatible = "micron,n25q256a", "jedec,spi-nor";
  62                 spi-max-frequency = <29000000>;
  63                 reg = <1>;
  64         };
  65 };